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[求助] 小猫盘,烧坏,

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zhla2899 发表于 2020-6-22 22:24:14 | 显示全部楼层 |阅读模式 IP:–湖北–黄冈 移动
这个猫盘是别人的,估计是接错TTL线,多接了VCC,现在是开机检测USB 会卡30秒左右,然后开机以后,在装载群晖安装文件的时候,安装错误,反复检测硬盘,
. n% I# l" u2 q
QQ图片20200622221702.png
QQ图片20200622221714.png
QQ图片20200622221718.png
QQ图片20200622221723.png

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 楼主| zhla2899 发表于 2020-6-22 22:25:34 | 显示全部楼层 IP:–湖北–黄冈 移动
不知道是哪个零件坏了,

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 楼主| zhla2899 发表于 2020-6-23 13:24:24 | 显示全部楼层 IP:–湖北–黄冈 移动
本帖最后由 zhla2899 于 2020-6-23 03:45 编辑 0 S* K+ L' ?7 j4 o+ r
7 k* V6 q+ y# S. P
ata1: irq_ stat 0x80000040, connection status changed. V/ `0 ?6 ~0 M% G0 {- y
ata1: SError: { DevExch }
/ i6 l) X% y5 a% H6 f3 Wata 1: limiting SATA link speedto 1.5 Gbps  P# t: D8 ~+ F, C/ s* |+ F
ata1: hard resetting link% H$ }( R; b! e/ w

$ W* M; U3 P7 Z* H. V% S5 [1 `  Q/ m( L, f& f' U
Failed to end USB2 PLL calibration6 C0 Y  U& ^! S$ B" S
Failed to end USB2 impedance calibration. s2 p8 L% r8 J  {9 n4 K& V
Failed to end USB2 unknown calibration
0 U- O1 o" L' tFailed to lockUSB2 PLL
4 s  Y8 y) N) ^

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kzgg 发表于 2020-6-23 14:23:54 | 显示全部楼层 IP:–浙江–温州 电信
如果是外围元件坏了,或许拿个放大镜可以发现问题,如果是芯片坏了,也就可以放弃了。

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brightforce 发表于 2020-6-23 17:09:22 | 显示全部楼层 IP:–江西–南昌 联通
芯片坏了,也就可以放弃了

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 楼主| zhla2899 发表于 2020-6-23 19:14:09 | 显示全部楼层 IP:–湖北–黄冈 移动
kzgg 发表于 2020-6-22 22:53' O: c! \, S& |5 k; w/ U* ]' n
如果是外围元件坏了,或许拿个放大镜可以发现问题,如果是芯片坏了,也就可以放弃了。 ...

% r3 J+ N' w; ?& I0 ~刚才放大镜看了,看不出来,
1 n' o2 r; K% v% B7 [

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 楼主| zhla2899 发表于 2020-6-23 19:44:06 | 显示全部楼层 IP:–湖北–黄冈 移动
本帖最后由 zhla2899 于 2020-6-23 04:15 编辑
: d7 Q5 d4 }/ T6 P# Z
5 X2 @$ A% k5 X刚才用表测了一下,( S3 S+ a+ F+ c* _" Y
USB的3.3V电压没有,只有0V,0 `* ?+ R2 a6 i% L+ N
不知道控制这个3.3V电压的是你哪一个," V, Z: c& t5 q' U
. S1 E& }. g5 O6 s) D, H

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kzgg 发表于 2020-6-23 22:32:12 | 显示全部楼层 IP:–浙江–温州 电信
zhla2899 发表于 2020-6-22 21:54
' V! f& f  o- h7 E& Xata1: irq_ stat 0x80000040, connection status changed
: h$ q( E; u$ Aata1: SError: { DevExch }
7 R: }+ I* S2 z: s. X- _" ^3 u$ C6 Vata 1: limiting SATA ...

4 n) k. e; ~- a& v* I2 L从“Failed to end USB2 PLL calibration”的字面意思翻译是:无法结束USB2 PLL校准。9 y8 B; K: c/ N/ ]2 N
“Failed to lockUSB2 PLL”的字面意思是:锁定USB2 PLL失败。PLL(Phase Locked Loop): 为锁相回路或锁相环,用来统一整合时钟信号,使高频器件正常工作,如内存的存取资料等。PLL用于振荡器中的反馈技术。 许多电子设备要正常工作,通常需要外部的输入信号与内部的振荡信号同步。一般的晶振由于工艺与成本原因,做不到很高的频率,而在需要高频应用时,由相应的器件VCO,实现转成高频,但并不稳定,故利用锁相环路就可以实现稳定且高频的时钟信号。检查相关器件。

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kzgg 发表于 2020-6-23 22:47:11 | 显示全部楼层 IP:–浙江–温州 电信
本帖最后由 kzgg 于 2020-6-23 07:18 编辑 $ s0 @! k8 H, `6 `! w+ A

. I6 m$ i' |, R1 ^5 D7 W9 U如果你板子的3.3V电压没有,可能是CPU凉了。有个小视频,你自己去看看或许有帮助。https://zhuanlan.zhihu.com/p/127975535
- a1 T1 ], s: W2 ]% x
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